新思科技IP核产品更新系列:高性能 DesignWare 存储接口IP
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想了解最新的新思科技 DesignWare 存储接口IP 吗?用于DDR5, LPDDR5, 以及HBM2/2E 。此外,我们还将教您如何使用我们的高性能、低功耗和面积的IP来配备你的 DRAM !
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想了解最新的新思科技 DesignWare 存储接口IP 吗?用于DDR5, LPDDR5, 以及HBM2/2E 。此外,我们还将教您如何使用我们的高性能、低功耗和面积的IP来配备你的 DRAM !
点击视频,进一步了解在 SC 2024大会上使用新思科技 CXL 3.x IP 和 Teledyne LeCroy 系统进行的全球首次 CXL 3.1 互操作演示。新思科技的 CXL 3. IP 作为端点系统,在实际操作中达到了 64 GT/s 的速率,成为实现下一代内存高效链路的重要里程碑。
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该视频展示了新思科技 112G 以太网 PHY IP 和 OpenLight 的 PIC 之间的线性/直接驱动互操作性演示。点击观看该演示,你可以看到这种设置可节省高达 35% 的功耗,并看到行业领先的信号完整性和开放式 PAM4 眼图。
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点击视频,详细了解新思科技 224G 以太网 PHY IP 和 PCIe 7.0 通过线性可插拔光学器件后展示出的卓越性能。线性驱动光学器件具有卓越的节能潜力,对下一代 HPC 芯片至关重要。
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在2023年欧洲光通信展(ECOC)上,新思科技使用 8 通道的 LR 112G 以太网 PHY IP 和 800G MAC/PCS, 通过 DAC 通道与试验程序、分析仪及第三方 800G EVB 进行互操作,显示链接、数据包接收/传输、FEC 直方图及其他性能指标。
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