PCIe 6.0 的 DesignWare 控制器和 PHY IP
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观看新思科技PCIe 6.0 技术的完整 IP 解决方案演示,展示了控制器在 FLIT 模式下以 64GT/s 速度的运行,以及 5 纳米工艺的PAM-4 PHY 在32dB PCIe 通道实现了优于PCIe规范两个数量级的 BER。
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观看新思科技PCIe 6.0 技术的完整 IP 解决方案演示,展示了控制器在 FLIT 模式下以 64GT/s 速度的运行,以及 5 纳米工艺的PAM-4 PHY 在32dB PCIe 通道实现了优于PCIe规范两个数量级的 BER。
使用 OpenLight 的 PIC,可在完整的 E-O-E 链路上查看新思科技 PCIe 6.0 PHY 电气均衡功能,无需重定时器即可实现线性/直接驱动。该演示展示了一种可实现数据中心高能效、低延迟解耦的途径。
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在2023年欧洲光通信展(ECOC)上,新思科技使用 8 通道的 LR 112G 以太网 PHY IP 和 800G MAC/PCS, 通过 DAC 通道与试验程序、分析仪及第三方 800G EVB 进行互操作,显示链接、数据包接收/传输、FEC 直方图及其他性能指标。
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